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揮別製程物理極限 半導體異質整合的創新與機遇 (2024.08.21)
半導體異質整合是將不同製程的晶片整合，以提升系統性能和功能。
在異質整合系統中，訊號完整性和功率完整性是兩個重要的指標。
因此必須確保系統能夠穩定地傳輸訊號，和提供足夠的功率 |
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AI運算方興未艾 3D DRAM技術成性能瓶頸 (2024.08.21)
HBM非常有未來發展性，特別是在人工智慧和高效能運算領域。隨著生成式AI和大語言模型的快速發展，對HBM的需求也在增加。主要的記憶體製造商正在積極擴展採用3D DRAM堆疊技術的HBM產能，以滿足市場需求 |
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3D IC與先進封裝晶片的多物理模擬設計工具 (2024.07.25)
在3D IC和先進封裝領域，多物理模擬的工具的導入與使用已成產業界的標配，尤其是半導體領頭羊台積電近年來也積極採用之後，更讓相關的工具成為顯學。 |
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高速運算平台記憶體爭霸 (2024.07.02)
各類AI應用的市場需求龐大，各種記憶體的競爭也異常的激烈，不斷地開發更新產品，降低成本，企圖向上向下擴大應用，只有隨時保持容量、速度與可靠度的優勢才是王道 |
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西門子推出全新Calibre 3DThermal軟體 強化3D IC市場布局 (2024.06.30)
西門子數位工業軟體近日宣佈推出 Calibre 3DThermal 軟體，用於 3D 積體電路（3D-IC）熱分析、驗證與除錯。Calibre 3DThermal 將 Calibre 驗證軟體和 Calibre 3DSTACK 軟體的關鍵能力，以及西門子 Simcenter Flotherm 軟體運算引擎相結合 |
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工研院突破3D先進封裝量測成果 新創公司歐美科技宣布成立 (2024.05.02)
在人工智慧（AI）浪潮席捲全球之下，工研院新創公司「歐美科技」今（30）日宣布成立，將藉由非破壞光學技術為半導體先進封裝帶來突破性的檢測應用，運用半導體矽穿孔量測研發成果，推動AI晶片高階製程提升整體良率，幫助半導體業者快速鑑別產品，也獲得德律科技、研創資本、新光合成纖維等注資 |
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聯電與供應鏈夥伴啟動W2W 3D IC專案 因應邊緣AI成長動能 (2023.10.31)
聯華電子今(31)日宣佈，已與合作夥伴華邦電子、智原科技、日月光半導體和Cadence成立晶圓對晶圓（wafer-to-wafer；W2W）3D IC專案，協助客戶加速3D封裝產品的生產。此項合作案是利用矽堆疊技術，整合記憶體及處理器，提供一站式堆疊封裝平台，以因應AI從雲端運算延伸到邊緣運算趨勢下，對元件層面高效運算不斷增加的需求 |
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應材分享5大挑戰技術與策略 看好2030年半導體產值兆元美金商機 (2023.09.05)
因應人工智慧（AI）、物聯網產業興起，將進一步提高晶片需求並，推動半導體產業成長，預計最快在2030年產值可望突破1兆美元。然而，晶片製造廠商同時也須面臨維持創新步伐的重大挑戰，美商應用材料公司（APPLIED MATERIALS）也在今（5）日分享，將之歸類為「5C」大挑戰，以及對應提出的研發技術平台與策略 |
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「光」速革命 AI世代矽光子帶飛 (2023.08.28)
矽光子商機持續發酵，市調機構Yole預測，2021年的矽光子（裸晶）市場規模為1.52億美元，2027年可望攀升至9.27億美元，年複合成長率達36%。這些數據不難看出，矽光子的成長爆發力多麼驚人 |
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晶背供電技術的DTCO設計方案 (2023.08.11)
比利時微電子研究中心（imec）於本文攜手矽智財公司Arm，介紹一種展示特定晶背供電網路設計的設計技術協同優化（DTCO）方案，其中採用了奈米矽穿孔及埋入式電源軌來進行晶背佈線 |
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應材創新混合鍵合與矽穿孔技術 精進異質晶片整合能力 (2023.07.13)
面對當前國際半導體市場競爭加劇，應用材料公司也趁勢推出新式材料、技術和系統，將協助晶片製造商運用混合鍵合（hybrid bonding）及矽穿孔（TSV）技術，將小晶片整合至先進2.5D和3D封裝中，既提高其效能和可靠性，也擴大了應材在異質整合（heterogeneous integration, HI）領域領先業界的技術範疇 |
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系統技術協同優化 突破晶片系統的微縮瓶頸 (2023.06.25)
本文內容說明系統技術協同優化（STCO）如何輔助設計技術協同優化（DTCO）來面對這些設計需求。 |
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台大跨團域隊研發AI光學檢測系統 突破3D-IC高深寬比量測瓶頸 (2023.04.26)
國立臺灣大學機械系陳亮嘉教授，今日帶領跨域、跨國的研發團隊，在國科會發表其半導體AI光學檢測系統的研發成果。該方案運用深紫外（DUV）寬頻光源作為光學偵測，並結合AI深度學習的技術，最小量測口徑可達 0.3 微米、深寬比可達到15，量測不確定度控制在50奈米以內，超越 SEMI 2025年官方所預測之技術需求規格 |
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看好晶片微縮進展 imec提出五大挑戰 (2023.03.13)
面對當代的重大挑戰時，人工智慧應用越來越廣泛，未來的運算需求預計會每半年翻漲一倍。為了在處理暴增的巨量資料的同時維持永續性，需要經過改良的高性能半導體技術 |
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摩爾定律碰壁 成本為選擇先進封裝製程的關鍵考量 (2022.07.29)
本場東西講座除了深度剖析晶片封裝技術趨勢與對策之外，更與親赴現場的開發業者廣泛交流，共同討論前景與挑戰。 |
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推動2D/3D IC升級 打造絕無僅有生醫感測晶片 (2022.06.22)
隨著半導體先進製程推進到2奈米（nm）之後，晶片微縮電路的布線與架構，就成為性能與可靠度的發展關鍵，而imec的論文則為2奈米以下的晶片製程找到了一條兼具可行性與可靠度的道路 |
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imec首度展示晶背供電邏輯IC佈線方案 推動2D/3D IC升級 (2022.06.17)
比利時微電子研究中心（imec）於本周舉行的2022年IEEE國際超大型積體電路技術研討會（VLSI Symposium），首度展示從晶背供電的邏輯IC佈線方案，利用奈米矽穿孔（nTSV）結構，將晶圓正面的元件連接到埋入式電源軌（buried power rail）上 |
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記憶體不再撞牆！ (2022.01.21)
新一代的高效能系統正面臨資料傳輸的頻寬限制，也就是記憶體撞牆的問題，運用電子設計自動化與3D製程技術.... |
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應用材料加速半導體產業實現異質整合技術藍圖 (2021.09.13)
應用材料發布新技術與能力，幫助客戶加速實現異質晶片設計與整合的技術藍圖。應用材料結合先進封裝與大面積基板技術，與產業合作夥伴攜手開發新解決方案，大幅改善晶片功率、效能、單位面積成本與上市時間(PPACt) |
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鑑往知來 洞察不同應用領域的DRAM架構（下） (2020.08.13)
本文上篇已回顧了各種DRAM的特色，下篇則將進一步探討3D結構發展下的DRAM類型，並分享愛美科的DRAM發展途徑。 |
