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Synopsys發表完整SystemVerilog設計及驗證流程 (2006.03.22)
半導體設計軟體解決方案廠商新思科技公司(Synopsys)20日宣佈，其設計及驗證產品的套裝軟體均已支援SystemVerilog語言，領先其他同業的腳步。同時，新思科技也率先推出支援SystemVerilog驗證IP的VCS Verification Library，並在Formality equivalence checker中增添SystemVerilog語法分析器(parser)之功能，說明了Synopsys在支援SystemVerilog的設計及驗證流程已更為完備 |
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Synopsys購併Numerical (2003.01.21)
美商新思科技(Synopsys)日前表示，該公司已與次波長感光印刷技術供應商Numerical公司簽訂最終合約，Synopsys將以每股七美元併購Numerical公司全部發行的普通股。該項併購將使電子設計自動化(EDA)以及感光印刷電路解決方案的兩間大廠合而為一，有助於降低設計積體電路的成本與風險 |
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Synopsys宣佈購併Avant! (2001.12.10)
新思科技(Synopsys)宣佈購併前達科技（Avant!），該公司為複雜晶體迴路（IC）設計的廠商，和前達科技(Avant!)為一家晶體迴路（IC）業界實體設計與晶體層級設計的廠商，根據協議，對於未出清Avant!股票的股東一張將可換取得0.371張Synopsys的股票，而且Avant!將成為Synopsys獨資的子公司，移交清算作業預計於3到6個月內完成 |
