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Cadence与联电合作开发22ULP/ULL制程认证 加速5G与车用设计 (2021.07.13)
联华电子今日宣布，Cadence优化的数位全流程，已获得联华电子22 奈米超低功耗 (ULP) 与 22 奈米超低漏电 (ULL) 制程技术认证，以加速消费、5G 和汽车应用设计。该流程结合了用于超低功耗设计的领先设计实现和签核技术，协助共同客户完成高品质的设计并实现更快的晶片设计定案 (tapeout) 流程
捷码Talus及Quartz软件通过台积电40奈米验证 (2008.06.25)
芯片设计解决方案供货商Magma捷码科技发表了Talus IC应用程序、Quartz SSTA统计分析、Quartz DFM、Quartz LVS及SiliconSmart DFM等产品，都能经由台积电（TSMC）的Reference Flow 9.0存取。这些工具软件完全支持台积电的「主动精准保证机制」（Active Accuracy Assurance Initiative），这项机制定订了台积电旗下所有设计生态伙伴在精准方面的共同标准
捷码、明导与新思共同推出统一功率格式产品 (2008.02.01)
捷码科技有限公司(Magma Design Automation Inc.)、明导国际(Mentor Graphics Corporation)和新思科技(Synopsys, Inc.)，宣布三家公司将共同推出符合Accellera发展的统一功率格式标准UPF 1.0的低功率EDA(电子设计自动化)工具组，包括这三家公司制造的各种实作与验证工具


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