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CTIMES / 柏士半導體（cypress_16
科技
典故		 从演化到多元整合──浅介Bus规格标准的变迁

一个想要满足于不同市场需求的通用型Bus标准界面，能否在不断升级传输速度及加大带宽之外，达到速度、容量、质量等多元整合、提升效能为一体的愿望？
Cypress发表新型Cyber​​Clocks时脉工具组 (2003.01.23)
柏士半导体(Cypress)日前发表新型全方位时脉研发工具组-Cyber​​Clocks。此款新软体针对可编程时脉的设定提供一套“黑箱”作业模式，能有效简化时脉设计的流程。相较于传统针对熟悉锁相回路(phased-locked loop, PLL)技术的工程师所设计之软体

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