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Avago將SerDes ASIC核心設計帶向65 nm製程技術
 

【CTIMES/SmartAuto 劉筱萍報導】   2006年06月28日 星期三

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安華高科技(Avago Technologies)28日宣佈,該公司已經成為業界率先在65 nm CMOS製程技術上實現並驗串列/解串列(SerDes)核心的製造商之一,這個里程碑將SerDes ASIC核心設計由現有主流的90 nm帶向65 nm製程技術。在市場上已經銷售出2千5百萬組嵌入式SerDes通道,已成為OEM廠商架構新一代網路、運算以及儲存應用硬體設備創新嵌入式SerDes核心的領先供應商。

Avago的嵌入式SerDes智慧產權(IP,Intellectual Property)核心提供了超低振動的特性,使得它能夠在單一65 nm互補金氧半導體(CMOS,Complementary Metal Oxide)晶片上,整合大量所需的SerDes通道,運作速度並可達到12.5 Gbps。此外,這個新SerDes核心採用了Avago特有的無時鐘判別回授等化器(DFE,Decision Feedback Equalization)設計、可提供通道位元錯誤率最佳化的內建BERT、改善電源雜訊拒斥能力的LC型振盪器,以及可以用來測試交流偶合連線的1149.6 AC-Extest等。

「這項技術的突破代表了我們第五代SerDes核心將繼續提供給網路與運算OEM廠商大幅的競爭優勢。」Avago台灣區總經理游本慶指出,「我們的客戶不僅能夠透過我們的協助提供具備卓越可靠度的高頻寬系統,同時還能降低尺寸、複雜度與成本。」

這個核心是Avago包含針對光纖通道、XAUI/CEI、XFI、802.3ap與PCI-Express等應用豐富廣泛嵌入式SerDes產品線的最新產品。Avago早在定義系統級架構的初期就整合了可測試功能,並考慮到線上生產測試、功能測試、系統啟動與除錯以及現場診斷等需求,所帶來的成果是能夠讓製造商以更快的時間將可靠的高頻寬網路與儲存系統推出上市。

關鍵字: 安華高  游本慶 
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