在選用積體電路產品時，目前大多數設計工程師都會同時注重低耗電以及運作效能表現，每顆晶片所節省的幾mA靜態耗電看起來雖然不多，但對擁有數10顆晶片的電路板而言累積起來的結果也是不可忽視的，透過這樣的節省方式可以搭配使用較小型的電源，同時耗電也較低，而對以電池運作的小型化便攜式設備來說，電源的節省還能帶來更長的電池運作時間。

由於採用了低耗電CMOS製程與智慧化電源管理，目前可攜式設備的運作時間已經可以達到相當長，電源電壓在過去數年也大幅降低，目前已經有許多設計採用3.3V的主電源，甚至可以由單一顆鋰離子電池直接運作。半導體製造商在過去為了滿足這些低電壓環境上RS-232標準的普遍需求也想出了許多聰明的做法，但現在卻必須為節省更多的耗電而進行妥協，這篇文章將討論如何透過採用相容但非完全符合的策略來以最低可能的耗電實現介面的來運作。

終極挑戰：低於+3.0V的電源
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